主题：从官方图解上，这颗全局快门感光器100%是像素级ADC，也就是2460万像素，2460万颗ADC！
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官方图解，之前的大尺寸堆栈式感光器（IMX 610；IMX 310等）两层结构中，位于像素模拟层下面的堆栈层，中间灰色的区域是DRAM，上下两侧橘红色区域是高速读出ADC电路。ADC和像素是无法一一对应的，没记错a1的IMX 610它是每列有12个ADC（总共也就10几万颗ADC）来完成5000万像素，14Bit，1/250s（ 4ms）的读出速度。
a9 III的图例非常明确，中间灰色的DRAM消失了，取而代之的全部是橘红色的高速读出ADC电路结构。而且图列中非常明确标明了每个像素点模拟信号都垂直传输到下层对应的像素位置的ADC上。所以实际上可以肯定这颗全局快门感光器是堆栈式的像素级ADC结构。也就是拥有2,460万像素，同时堆栈层上拥有2,460万颗ADC。 这就是它实现全局快门的奥秘！SONY牛逼，真被它搞出了量产化的像素级ADC的全画幅堆栈式全局快门感光器。
a9 III的图例非常明确，中间灰色的DRAM消失了，取而代之的全部是橘红色的高速读出ADC电路结构。而且图列中非常明确标明了每个像素点模拟信号都垂直传输到下层对应的像素位置的ADC上。所以实际上可以肯定这颗全局快门感光器是堆栈式的像素级ADC结构。也就是拥有2,460万像素，同时堆栈层上拥有2,460万颗ADC。 这就是它实现全局快门的奥秘！SONY牛逼，真被它搞出了量产化的像素级ADC的全画幅堆栈式全局快门感光器。
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jingtl 发表于 2023-11-09 08:21全局快门技术 Pregius™ / Pregius S™ | 产业用图像传感器 | 技术 | Sony Semiconductor Solutions Group (sony-semicon•com)
这个是sony官方自己网站上能找到的全局快门的介...
https://www_sony_com/en/SonyInfo/News/Press/201802/18-018E/
这是2018年官方通稿，第一个Pixel Parallel ADC样品
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nullfull 发表于 2023-11-09 13:50从形式结构上这种布局无法装在无反相机上，特别是像素的密度升高会使问题更加突兀。
我又没说装在相机上，我只是说前照感光器和堆栈式的组合SONY早做了。
而且最新的工业用中画幅全局快门感光器，那个1.28亿像素的IMX 661也是这种堆栈布局。
https://www_sony_com/en/SonyInfo/News/Press/202103/21-021E/
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BMWX6M 编辑于 2023-11-09 14:07
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BMWX6M 发表于 2023-11-09 08:42这个是基于传统的像素结构。但问题是堆栈式全局快门不是传统结构啊？下面SONY日本官方网站自己发布的产品图我都贴出来了，您没看吗？
这个是SONY中文官方自己直译的日本官网的新闻稿（差不多6年前的）。而此次发布的a9 III感光器，从SONY自己给出的...
堆栈式本身就是数字电路与模拟电路的一种物理复合所以堆栈式只能采用背照，而不是堆栈式用了背照更高级，堆栈式用在前照式相当于把眼睛蒙住，走不通的。
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jingtl 发表于 2023-11-09 09:49看到了。现在都是我们猜测。我前面看的网页介绍，应该是sony最新的技术介绍。从技术角度来说，如果真的是每个像素直接AD，那应该噪声、成像质量应该不比卷帘快门方式差才对。
前面有一个猜测可能是有道理的,也就是问题不在传感器结构上,而是在于发热上,热噪带来的背底升高造成了可用的iso范围变窄.
但另一个评论很对,不能要求完美的体育机也是完美的画质机和完美的视频机.
所以看sony对这块传感器的更多资料放出和下一块传感器的表现吧.
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BMWX6M 发表于 2023-11-09 09:12大哥，我的图是SONY官网啊！这是日文SONY官网的原稿， 这是SONY中文官网的翻译稿：
https://www•sony•com/ja/SonyInfo/News/Press/201802/18-018/
https://www•sony•com...
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jingtl 发表于 2023-11-09 08:55不知道你中文截图这个出处是哪里？
还是刚才的sony官网页面，下面有介绍背照式堆栈结构的优化。其实核心分歧是并列A/D实现的方式，是每个点对应一个ADC呢，还是每个点同步采样保持（S/H)，然后再多个采样(S/H)再逐次进行A/D转换。这两种方式都叫...
大哥，我的图是SONY官网啊！这是日文SONY官网的原稿， 这是SONY中文官网的翻译稿：
https://www_sony_com/ja/SonyInfo/News/Press/201802/18-018/
https://www.sony.com.cn/zh-cn/cms/newscenter/techonology/2018/20180227-1.html
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向这里的专家们学习，大概看明白了7、8成。
不能要求A9iii是完美（相对）速度机的同时还是完美（相对）的画质机和视频机吧？那是7R 7S的任务。或者说，是1系的任务。
不管它是以什么方式实现全局快门的，它最终就是第一个实现的。至于损失了动态范围、低感画质，那就又回到——不能要求A9iii是完美（相对）速度机的同时还是完美（相对）的画质机和视频机吧？
不能要求A9iii是完美（相对）速度机的同时还是完美（相对）的画质机和视频机吧？那是7R 7S的任务。或者说，是1系的任务。
不管它是以什么方式实现全局快门的，它最终就是第一个实现的。至于损失了动态范围、低感画质，那就又回到——不能要求A9iii是完美（相对）速度机的同时还是完美（相对）的画质机和视频机吧？
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BMWX6M 发表于 2023-11-09 08:42这个是基于传统的像素结构。但问题是堆栈式全局快门不是传统结构啊？下面SONY日本官方网站自己发布的产品图我都贴出来了，您没看吗？
这个是SONY中文官方自己直译的日本官网的新闻稿（差不多6年前的）。而此次发布的a9 III感光器，从SONY自己给出的...
还是刚才的sony官网页面，下面有介绍背照式堆栈结构的优化。其实核心分歧是并列A/D实现的方式，是每个点对应一个ADC呢，还是每个点同步采样保持（S/H)，然后再多个采样(S/H)再逐次进行A/D转换。这两种方式都叫同步（并行）ADC。啥事S/H，搞电子技术的都知道。
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jingtl 发表于 2023-11-09 08:21全局快门技术 Pregius™ / Pregius S™ | 产业用图像传感器 | 技术 | Sony Semiconductor Solutions Group (sony-semicon•com)
这个是sony官方自己网站上能找到的全局快门的介...
这个是基于传统的像素结构。但问题是堆栈式全局快门不是传统结构啊？下面SONY日本官方网站自己发布的产品图我都贴出来了，您没看吗？
这个是SONY中文官方自己直译的日本官网的新闻稿（差不多6年前的）。而此次发布的a9 III感光器，从SONY自己给出的信号点对点处理的图示看，很大概率就是这个技术的量产化。
而且结合SONY自己的官网公开的关于“积层型”（也就是中文的堆栈式）图像传感器的开发路线图（公布时间是2018年的SONY未来战略方向文档中关于半导体业务的重点发展战略），SONY对于全域快门的开发方向就是像素级ADC（日文叫：“画素并列A/D”）。如果是基于堆栈式结构的全域快门，那大概率就是这一开发方向。 您说得Pregius是SONY专为工业生产检测开发的工业用感光器，它和强调画质的影像制作用感光器是完全两条路线。Pregius系列大部分产品都是基于“原始”的传统前照式（FSI）结构的，背照的BSI都很少。更不要说背照+堆栈。
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melfes 发表于 2023-11-08 22:58写出这样的话只能说明是你孤陋寡闻了
全局快门技术 Pregius™ / Pregius S™ | 产业用图像传感器 | 技术 | Sony Semiconductor Solutions Group (sony-semicon_com)
这个是sony官方自己网站上能找到的全局快门的介绍。你可以参考下是不是说明了你自己的盲目自大。
如果他相机也是这个技术路线，那就实打实是我说的多通道同步采样，再依次AD转换。这应该是实现全局快门的最高性价比方式。
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BMWX6M 发表于 2023-11-08 23:45SONY在6年前发布的样品就是基于每个像素都对应一个ADC，来做全域快门的。只是那个样品像素比较低只有150万左右，对应的ADC也是150万个（6年前那块像素级ADC的具体性能是150万像素/14Bit/660fps）。6年过去了，目前SONY开发全...
A9III目前来看很可能就是这歌样品的全幅版本，样品像素的6.9um规格距离A9III的6um像素尺寸已经很接近了，而且样品的ADC精度已经是14bit，隔了这么久提高了全幅良品率应该可以了
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jingtl 发表于 2023-11-08 21:52绝对不可能2460万个ADC。如果你搞过硬件（模数转换），可以了解下通过S/H电路实现多通道同步采样然后依次AD转换的模式。
至于具体到a9 III的CMOS上来，是不是像素级ADC，很像，但并不确定。以漫长的6年的开发时间来说，2400万像素的像素级ADC的全局快门也基本可以做到了。
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BMWX6M 编辑于 2023-11-08 23:55
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